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Circuito programmabile EPM3128ATC144-10 Chip IC programmabili Famiglia di dispositivi logici programmabili

fabbricante:
Produttore
Descrizione:
IC CPLD 128MC 10NS 144TQFP
Categoria:
Driver ICs dell'esposizione
Prezzo:
Negotiate
Metodo di pagamento:
T/T, Western Union, Paypal
Specifiche
Tensione di rifornimento:
– 0,5 - 4,6 V
La CC la tensione in ingresso:
– 2,0 - 5,75 V
La CC corrente d'uscita, per perno:
– 25 - 25 mA
Temperatura di stoccaggio:
– 65 150 a ° C
Temperatura ambiente:
– 65 135 a ° C
TEMPERATURA DI GIUNZIONE:
135 ° C
Punto culminante:

programming ic chips

,

ic programmer circuit

Introduzione

 
Famiglia di dispositivi logici programmabili MAX 3000A
Caratteristiche
■ Dispositivi logici programmabili (PLD) basati su EEPROM CMOS ad alte prestazioni ea basso costo costruiti su un'architettura MAX®
■ Programmabilità in-system (ISP) a 3,3 V tramite il protocollo IEEE Std.Interfaccia JTAG (Joint Test Action Group) 1149.1 con funzionalità avanzate di blocco dei pin - circuiti ISP conformi a IEEE Std.1532
■ Circuiti BST (boundary-scan test) integrati conformi a IEEE Std.1149.1-1990
■ Funzionalità ISP migliorate: – Algoritmo ISP migliorato per una programmazione più rapida – Bit ISP_Done per garantire una programmazione completa – Resistenza di pull-up sui pin I/O durante la programmazione interna al sistema
■ PLD ad alta densità che vanno da 600 a 10.000 porte utilizzabili
■ Ritardi logici pin-to-pin di 4,5 ns con frequenze di conteggio fino a 227,3 MHz
■ Interfaccia I/O MultiVoltTM che consente al core del dispositivo di funzionare a 3,3 V, mentre i pin I/O sono compatibili con i livelli logici 5,0–V, 3,3–V e 2,5–V
■ Numero di pin compreso tra 44 e 256 in una vasta gamma di thin quad flat pack (TQFP), plastic quad flat pack (PQFP), plastic J-lead chip carrier (PLCC) e FineLine BGATM package
■ Supporto hot-socket
■ Struttura di instradamento continuo PIA (Programmable Interconnect Array) per prestazioni rapide e prevedibili
■ Intervallo di temperatura industriale
■ PCI compatibile
■ Architettura bus-friendly con controllo della velocità di risposta programmabile
■ Opzione di uscita a scarico aperto
■ Infradito a macrocelle programmabili con controlli individuali di cancellazione, preimpostazione, clock e abilitazione clock
■ Modalità di risparmio energetico programmabile per una riduzione di potenza superiore al 50% in ogni macrocella
■ Distribuzione configurabile prodotto-termine dell'espansore, che consente fino a 32 termini prodotto per macrocella
■ Bit di sicurezza programmabile per la protezione di progetti proprietari
■ Funzionalità avanzate dell'architettura, tra cui: – Segnali di abilitazione dell'uscita guidati dalla logica o a 6 o 10 pin – Due segnali di clock globali con inversione opzionale – Risorse di interconnessione migliorate per una migliore instradabilità – Controllo programmabile della velocità di risposta dell'uscita
■ Supporto per la progettazione del software e posizionamento e instradamento automatici forniti dai sistemi di sviluppo di Altera per PC basati su Windows e Sun SPARCstation e workstation HP 9000 Series 700/800
■ Ulteriori elementi di progettazione e supporto per la simulazione forniti da file netlist EDIF 2 0 0 e 3 0 0, libreria di moduli parametrizzati (LPM), Verilog HDL, VHDL e altre interfacce per strumenti EDA popolari di produttori di terze parti come Cadence, Exemplar Logica, Mentor Graphics, OrCAD, Synopsys, Synplicity e VeriBest
■ Supporto della programmazione con l'unità di programmazione master (MPU) Altera, il cavo di comunicazione MasterBlasterTM, il cavo di download della porta parallela ByteBlasterMVTM, il cavo di download seriale BitBlasterTM nonché l'hardware di programmazione di produttori terzi e qualsiasi tester in-circuit che supporti JamTM Standard Test and Programming File di lingua (STAPL) (.jam), file di codice byte Jam STAPL (.jbc) o file di formato vettoriale seriale (.svf)
descrizione funzionale
L'architettura MAX 3000A include i seguenti elementi:
■ Logic array block (LAB)
■ Macrocelle
■ Termini del prodotto Expander (condivisibili e paralleli)
■ Array di interconnessione programmabile (PIA)
■ Blocchi di controllo I/O
L'architettura MAX 3000A include quattro ingressi dedicati che possono essere utilizzati come ingressi generici o come segnali di controllo globale ad alta velocità (segnali di clock, clear e due output enable) per ogni macrocella e pin I/O.La Figura 1 mostra l'architettura dei dispositivi MAX 3000A.
Figura 1. Diagramma a blocchi del dispositivo MAX 3000A
Nota: (1) I dispositivi EPM3032A, EPM3064A, EPM3128A e EPM3256A hanno sei uscite abilitate.I dispositivi EPM3512A hanno 10 uscite abilitate.
MAX 3000A Classificazioni massime assolute del dispositivo

SimboloParametroCondizioniminMassimoUnità
vCCTensione di alimentazioneRispetto al suolo(1)–0,54.6v
vIOTensione di ingresso CC-2.05.75v
IOFUORICorrente di uscita CC, per pin –2525mA
TSTGTemperatura di conservazioneNessun pregiudizio–65150°C
TUNTemperatura ambienteSotto pregiudizio–65135°C
TJTemperatura di giunzionePacchetti PQFP e TQFP, sotto bias 135°C

Nota:
(1) La tensione di ingresso CC minima è –0,5 V. Durante le transizioni, gli ingressi possono scendere fino a –2,0 V o superare fino a 5,75 V per correnti di ingresso inferiori a 100 mA e periodi inferiori a 20 ns.
 
 
 
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MC9S08GT8AMFBBE4588SCALA LIBERA15+QFP
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