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16 12 bit ADC di Manica 1 MSPS con il sequenziatore in 28-Lead TSSOP AD7490BRUZ

fabbricante:
Produttore
Descrizione:
Un convertitore analogico-digitale 16 di 12 bit ha introdotto 1 SAR 28-TSSOP
Categoria:
Chip a circuito integrato
Prezzo:
Negotiate
Metodo di pagamento:
T/T, Western Union, Paypal
Specifiche
VDD a terra:
V di −0.3 V - +7
VDRIVE a terra:
−0.3 V a VDD + 0,3 V
Tensione entrata analogica a terra:
−0.3 V a VDD + 0,3 V
Tensione in ingresso di Digital a terra:
V di −0.3 V - +7
Tensione in uscita di Digital a terra:
−0.3 V a VDD + 0,3 V
REFIN a terra:
−0.3 V a VDD + 0,3 V
Corrente di ingresso a qualsiasi Pin Except Supplies 1:
±10 mA
Gamma di temperature di stoccaggio:
−65°C a +150°C
Punto culminante:

electronic chip board

,

electronic components ic

Introduzione

16-Channel, 1 MSPS, 12 bit ADC con il sequenziatore in 28-Lead TSSOP

CARATTERISTICHE

Tasso veloce di capacità di lavorazione: 1 MSPS

Specificato per VDD di 2,7 V - 5,25 V

Potere basso ai tassi di capacità di lavorazione di massimo

un massimo di 5,4 Mw a kSPS 870 con 3 rifornimenti di V

un massimo di 12,5 Mw a 1 MSPS con 5 rifornimenti di V

16 input (asimmetrici) con il sequenziatore

Ampia larghezza di banda dell'input

69,5 dB SNR a 50 chilocicli di frequenza dell'input

Potere flessibile/gestione di serie di velocità di clock

Nessun ritardi della conduttura

Interfaccia seriale ad alta velocità, SPI/QSPI™/MICROWIRE™/DSP compatibile

Modo completo di arresto: 0,5 massimi del µA

28-lead TSSOP e 32 pacchetti del cavo LFCSP

SCHEMA A BLOCCHI FUNZIONALE

DESCRIZIONE GENERALE

Il AD7490 è le 12 alte velocità pungenti, il potere basso, 16 il canale, l'approssimazione successiva ADC. La parte funziona a partire l'alimentazione elettrica singola 2,7 V di 5,25 - di V ed i tassi di capacità di lavorazione delle caratteristiche fino a 1 MSPS. La parte contiene un amplificatore a basso rumore e ampio della pista-e-tenuta di larghezza di banda che può trattare le frequenze dell'input al di sopra di 1 megahertz.

Il processo di conversione ed il dell'acquisizione dei dati sono controllati facendo uso di CS e del segnale di orologio di serie, permettendo che il dispositivo colleghi mediante interfaccia facilmente ai microprocessori o a DSPs. Il segnale in ingresso è provato sul bordo di caduta di CS e la conversione inoltre è iniziata a questo punto. Non ci sono ritardi della conduttura connessi con il divisorio.

Il AD7490 usa le tecniche di progettazione avanzate per raggiungere molto la dissipazione di potere basso agli alti tassi di capacità di lavorazione. Per i tassi di capacità di lavorazione di massimo, il AD7490 consuma appena 1,8 mA con 3 rifornimenti di V e 2,5 mA con 5 rifornimenti di V.

Mettendo i pezzi pertinenti nel registro di controllo, la gamma dell'entrata analogica per la parte può essere selezionata per essere le 0 V - input di REFIN o le 0 V - 2 input del × REFIN, con qualsiasi codifica dell'uscita del complemento a due o del file binario diritto. Il AD7490 caratterizza 16 entrate analogiche asimmetriche con un sequenziatore del canale per permettere che una selezione preprogrammata dei canali sia convertita in sequenza. Il tempo di conversione è determinato dalla frequenza di SCLK perché questo inoltre è usato come l'orologio principale per controllare la conversione.

Il AD7490 è disponibile 32 in un cavo LFCSP e 28 in un pacchetto del cavo TSSOP.

PUNTI CULMINANTI DEL PRODOTTO

1. Il AD7490 offre i tassi di fino a 1 capacità di lavorazione di MSPS. A capacità di lavorazione massima con 3 rifornimenti di V, il AD7490

dissipa appena 5,4 Mw di potere.

2. Una sequenza dei canali può essere selezionata, tramite cui i cicli AD7490 ed i convertiti.

3. Il AD7490 funziona a partire singola 2,7 da un rifornimento V di 5,25 - di V. La funzione di VDRIVE permette l'interfaccia seriale

per collegarsi direttamente ad un indipendente sistemi di trattamento del linguaggio di V di 5 o di neanche 3 V da VDD.

4. Il tasso di conversione è determinato dall'orologio di serie, permettendo che il tempo di conversione sia ridotto da parte a parte

l'aumento di serie di velocità di clock. La parte inoltre caratterizza i vari modi di arresto per massimizzare l'efficienza energetica

ai tassi più bassi di capacità di lavorazione. Il consumo di energia è 0,5 µA, massimo, quando nell'arresto completo.

5. La parte caratterizza un'approssimazione successiva standard ADC con controllo accurato dell'istante di campionamento via

un input del CS ed una volta fuori da controllo di conversione.

TUM di VALUTAZIONI MASSIME ASSOLUTE = 25°C, salvo indicazione contraria.

Parametro Valutazione

VDD a terra V di −0.3 V - +7

VDRIVE a terra −0.3 V a VDD + 0,3 V

Tensione entrata analogica a terra −0.3 V a VDD + 0,3 V

Tensione in ingresso di Digital a terra V di −0.3 V - +7

Tensione in uscita di Digital a terra −0.3 V a VDD + 0,3 V

REFIN a terra −0.3 V a VDD + 0,3 V

Corrente di ingresso a qualsiasi Pin Except Supplies 1 ±10 mA

Gamme di temperatura di funzionamento

Commerciale (versione di B) −40°C a +85°C

Gamma di temperature di stoccaggio −65°C a +150°C

Temperatura di giunzione 150°C

LFCSP, pacchetto di TSSOP, dissipazione di potere 450 Mw

impedenza termica del θJA 108.2°C/W (LFCSP)

97.9°C/W (TSSOP)

impedenza termica del θJC 32.71°C/W (LFCSP)

14°C/W (TSSOP)

Temperatura del cavo, saldante

Fase di vapore (sec 60) 215°C

Infrarosso (sec 15) 220°C

ESD 1 chilovolt

Le correnti transitorie 1 di fino a 100 mA non causano il fermo-su dell'SCR.

Gli sforzi sopra quelli elencati nell'ambito delle valutazioni massime assolute possono danneggiare permanente il dispositivo. Ciò è uno sforzo che valuta soltanto; l'operazione funzionale del dispositivo a questi o di alcuni altri termini sopra quelli indicati nella sezione operativa di questa specificazione non è implicata. L'esposizione ai termini di valutazione di massimo assoluta per i periodi estesi può colpire l'affidabilità del dispositivo.

PIEDINATURE E DESCRIZIONI DI FUNZIONE

Pin Function Descriptions

Pin No.

TSSOP LFCSP Mnemonico Descrizione

20 18 CS Chip Select. Input basso attivo di logica. Questo input fornisce il doppio

funzione di inizio delle conversioni sul AD7490 ed anche

incornicia il trasferimento di dati di serie.

23 21 REFIN Riferimento introdotto per il AD7490. Un riferimento esterno deve

applichi a questo input. La gamma di tensione per l'esterno

il riferimento è un ± 1% di 2,5 V per la prestazione specificata.

22 20 VDD L'alimentazione elettrica ha introdotto. La gamma di VDD per il AD7490 proviene da

2,7 V a 5,25 V. Per le 0 V - 2 la gamma del × REFIN, VDD dovrebbe

provenga da 4,75 V a 5,25 V.

14, 21, 24 12, 19, 22 AGND Terra analogica. Punto di riferimento al suolo per tutti i circuiti sul

AD7490. Tutti i segnali in ingresso analogici/digitali e qualsiasi esterno

il segnale di riferimento dovrebbe riferirsi a questa tensione di AGND.

Tutti i perni di AGND dovrebbero essere collegati insieme.

13 - 5, 11 - 9, VIN 0 - VIN 15 Entrata analogico 0 attraverso entrata analogica 15. Sedici asimmetrici

3 - 1, 7 - 2, canali di ingresso analogici che sono multiplexati nel sul chip

28 - 25 31 - 26, pista-e-tenuta. Il canale di ingresso analogico da convertire è

24 selezionato usando i pezzi ADD3 di indirizzo con ADD0 di

il registro di controllo. I pezzi di indirizzo, insieme con

I pezzi dell'OMBRA e SEGUENTI, permettono che il registro di sequenza sia

programmato. La gamma dell'input per tutti i canali di ingresso può

estenda da 0 V - da REFIN o da 0 V fino 2 × REFIN come selezionato

via il pezzo della GAMMA nel registro di controllo. Qualsiasi input inutilizzato

i canali dovrebbero essere collegati a AGND per evitare il rumore

raccolta.

19 17 BACCANO Dati dentro. Input di logica. Dati da scrivere al registro di controllo

del AD7490 è fornito su questo input ed è cronometrato in

il registro sul bordo di caduta di SCLK (vedi il controllo

Sezione del registro).

15 13 DOUT Dati fuori. Uscita di logica. Il risultato di conversione dal

AD7490 è fornito su questa uscita come flusso di dati di serie.

I pezzi sono cronometrati fuori sul bordo di caduta dello SCLK

input. Il flusso di dati consiste di quattro bit di indirizzo

indicando quale canale il risultato di conversione corrisponde

a, seguito dai 12 bit dei dati di conversione, che sono

fornito da MSB in primo luogo. La codifica dell'uscita può essere selezionata As

file binario diritto o complemento a due via il pezzo di CODIFICA dentro

il registro di controllo.

16 14 SCLK Orologio di serie. Input di logica. SCLK fornisce l'orologio di serie per

dati d'accesso dal divisorio. Questo input di orologio inoltre è usato

come la fonte dell'orologio per il processo di conversione del

AD7490.

17 15 VDRIVE L'alimentazione elettrica di logica ha introdotto. La tensione assicurata a questo perno

determina a che tensione l'interfaccia seriale del

AD7490 funziona.

N/A PE EPAD Cuscinetto esposto. Connect ha esposto il cuscinetto a terra.

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