Chip del circuito integrato di AD9511BCPZ 1,2 gigahertz di distribuzione di orologio IC Chip Golden China Supplier
digital integrated circuits
,linear integrated circuits
Chip del circuito integrato di AD9511BCPZ 1,2 gigahertz di distribuzione di orologio IC Chip Golden China Supplier
CARATTERISTICHE
Il centro con aggancio di fase del ciclo di rumore basso di fase
Frequenze dell'input di riferimento a 250 megahertz
Prescaler programmabile del doppio-modulo
Corrente programmabile della pompa di carica (CP)
Il rifornimento separato di CP (VCPS) estende la gamma di sintonia
Due 1,6 gigahertz, input di orologio differenziale
5 divisori programmabili, 1 - 32, tutti i numeri interi
Fase scelta per il ritardo grezzo dell'uscita--uscita regolare
3 uscite indipendenti di 1,2 gigahertz LVPECL
L'uscita additiva nervoso 225 il fs rms
2 800 uscite di orologio indipendenti di MHz/250 megahertz LVDS/CMOS
L'uscita additiva nervoso 275 il fs rms
Il ritardo fine regola su 1 uscita di LVDS/CMOS
Porto di serie di controllo
Cavo LFCSP di economia di spazio 48
APPLICAZIONI
Nervosismo basso, distribuzione di orologio bassa per la misurazione del rumore di fase
ADC ad alta velocità di sincronizzazione, DACs, DDSs, DDCs, DUCs, MxFEs
Ricetrasmettitori senza fili di rendimento elevato
Strumentazione di rendimento elevato
Infrastruttura a banda larga
DESCRIZIONE GENERALE
Il AD9511 svolge una funzione a uscite multiple di distribuzione dell'orologio con il centro del su chip PLL.
La progettazione sottolinea il nervosismo ed il rumore bassi di fase per massimizzare la prestazione del convertitore di dati.
Altre applicazioni con i requisiti richiedenti di rumore e del nervosismo di fase inoltre traggono giovamento da questo divisorio.
La sezione di PLL consiste di un divisore programmabile di riferimento (r); un rivelatore a basso rumore di frequenza di fase (PFD); una pompa di carica di precisione (CP); e un divisore programmabile di risposte (n).
Collegando un VCXO o un VCO esterno ai perni di CLK2/CLK2B, le frequenze fino a 1,6 gigahertz possono essere sincronizzate al riferimento dell'input.
Ci sono cinque uscite di orologio indipendente. Tre uscite sono LVPECL (1,2 gigahertz) e due sono selezionabili come qualsiasi livelli di LVDS (800 megahertz) o di CMOS (250 megahertz).
Ogni uscita ha un divisore programmabile che può essere escluso o messo per dividersi da qualsiasi numero intero fino a 32. La fase di un'uscita di orologio riguardante un'altra uscita di orologio può essere variata per mezzo di una funzione scelta di fase del divisore che serve da adeguamento cronometrante grezzo.
Una delle uscite di LVDS/CMOS caratterizza un elemento di ritardo programmabile con le gamme complete fino a 10 NS di ritardo. Questo blocchetto regolantesi di ritardo ha risoluzione pungente 5, dante 32 ritardi possibili da cui scegliere per ogni regolazione completa.
Il AD9511 è adatto idealmente per le applicazioni di sincronizzazione del convertitore di dati da dove la prestazione massima del convertitore è raggiunta codifica i segnali con il nervosismo del subpicosecond. Il AD9511 è disponibile 48 in un cavo LFCSP e può essere azionato a partire da un singolo rifornimento di 3,3 V.
Un VCO esterno, che richiede una gamma estesa di tensione, può essere accomodato collegando il rifornimento della pompa di carica (VCP) a 5,5 V. La gamma di temperature è −40°C a +85°C.
Gamma di temperature – 40°C a +85°C
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