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Logica programmabile ICC massimo ICS Flip Flops Positive Edge Trig del μA di SN74LVC2G74DCUR 10

fabbricante:
Produttore
Descrizione:
Flip Flop 1 elemento 1 D tipo ha morso il bordo positivo 8-VFSOP (0,091", larghezza di 2.30mm)
Categoria:
Chip di IC di memoria flash
Prezzo:
Contact us
Metodo di pagamento:
Paypal, Western Union, TT
Specifiche
Tensione di rifornimento - min:
1,65 V
Tensione di rifornimento - massima:
5,5 V
Temperatura di funzionamento minima:
- 40 C
Temperatura di funzionamento massima:
+ 125 C
Montaggio dello stile:
SMD/SMT
Pacchetto/caso:
VSSOP-8
Punto culminante:

programmable computer chip

,

logic integrated circuits

Introduzione

Logica programmabile ICS Flip Flops Positive Edge Trig di SN74LVC2G74DCUR

Caratteristiche 1

  • Disponibile nel pacchetto di Texas Instruments NanoFreeTM
  • Sostiene l'operazione di 5-V VCC
  • Gli input accettano le tensioni a 5,5 V
  • Maxtpd of5.9nsat3.3V
  • Basso consumo energetico, 10 μA ICC massimo
  • ±24-mA ha prodotto l'azionamento a 3,3 V
  • VOLP tipico (rimbalzo al suolo dell'uscita) <0>
  • VOHV tipico (uscita VOH sottostimata) >2VatVCC =3.3V, TUM =25°C
  • Ioff sostiene Live Insertion, il modo di Parziale-potere-Giù e la protezione dell'Retro-azionamento
  • La prestazione del fermo-Su supera 100 mA per JESD 78, classe II
  • La protezione di ESD supera JESD 22
  • – modello del Umano-corpo 2000-V
  • – modello di macchina 200-V
  • – modello del Fare pagare-dispositivo 1000-V

2 applicazioni

  • Server
  • Esposizioni di LED
  • Commutatore di rete
  • Infrastruttura delle Telecomunicazioni
  • Driver del motore
  • Estensori dell'ingresso/uscita

Descrizione 3

Questo singolo flip-flop D tipo positivo-bordo-avviato è progettato per 1.65-V all'operazione di 5.5-V VCC.

La tecnologia del pacchetto di NanoFreeTM è un'innovazione importante nei concetti d'imballaggio di IC, facendo uso del dado come il pacchetto.

Un a basso livello al preregolamento (PRE) o chiaramente input (CLR) mette o risistema le uscite, indipendentemente dai livelli degli altri input. Quando PRE e CLR sono inattivi (alto), dati ai dati (D) la riunione dell'input i requisiti di in tempo installato è trasferita alle uscite sul bordo positivo-andante dell'impulso di temporizzazione. Cronometri l'avviamento si presenta ad un livello di tensione e non è riferito direttamente al periodo di aumento dell'impulso di temporizzazione. A seguito dell'intervallo tempo tenuta, i dati all'input di D possono essere cambiati senza colpire i livelli alle uscite.

Questo dispositivo completamente è specificato per le applicazioni di parziale-potere-giù facendo uso di Ioff. I circuiti di Ioff disattivano le uscite, impedicenti danneggiando il riflusso corrente tramite il dispositivo quando sono spenti.

Informazioni del dispositivo

NUMERO DEL PEZZO

PACCHETTO

DIMENSIONE CORPOREA

SN74LVC2G74

SM8 (8)

2,95 millimetri di × 2,80 millimetri

VSSOP (8)

2,30 millimetri di × 2,00 millimetri

DSBGA (8)

1,91 millimetri di × 0,91 millimetri

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