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Gate array programmabile FPGA - ciclone III di logica di EP3C55F484C8N EP3C55U484I7N del campo programmabile del ICS 3491 IOS dei laboratori 327

fabbricante:
Produttore
Descrizione:
Gate array programmabile del campo di Cyclone® III (FPGA) IC 327 2396160 55856 484-BGA
Categoria:
Chip di IC di memoria flash
Prezzo:
Contact us
Metodo di pagamento:
Paypal, Western Union, TT
Specifiche
Peso specifico:
0,250445 once
Montaggio dello stile:
SMD/SMT
Memoria totale:
bit 2396160
Tensione di rifornimento di funzionamento:
Da 1,15 V a 1,25 V
Numero di I/Os:
Ingresso/uscita 327
Produttore:
Intel
Punto culminante:

logic integrated circuits

,

programmable logic array ic

Introduzione

Gate array programmabile FPGA - ciclone III di logica di EP3C55F484C8N EP3C55U484I7N del campo programmabile del ICS 3491 IOS dei laboratori 327

Architettura della famiglia del dispositivo del ciclone III

La famiglia del dispositivo del ciclone III comprende una caratteristica cliente-definita messa che è ottimizzata per le applicazioni portatili ed offre una vasta gamma di densità, di memoria, di moltiplicatore incluso e di opzioni dell'ingresso/uscita. La famiglia del dispositivo del ciclone III sostiene le numerose interfacce esterne di memoria ed i protocolli dell'ingresso/uscita che sono comuni nelle applicazioni in grande quantità. I pacchetti software di Quartus II ed i centri parameterizable del IP renderla più facile affinchè usino le interfacce ed i protocolli della famiglia del dispositivo del ciclone III.

Le seguenti sezioni forniscono una panoramica delle caratteristiche della famiglia del dispositivo del ciclone III.

Blocchetti degli elementi di logica e di matrice di logica

Il blocchetto di matrice di logica (LABORATORIO) consiste di 16 elementi di logica e di un blocco di controllo Laboratorio di ampiezza. Un LE è la più piccola unità di logica nell'architettura della famiglia del dispositivo del ciclone III. Ogni LE ha quattro input, una tavola di occhiata dell'quattro-input (LUT), un registro e logica dell'uscita. L'quattro-input LUT è un generatore di funzioni che può implementare qualunque funzione con quattro variabili.

Blocchetti di memoria

Ogni blocchetto di memoria di M9K della famiglia del dispositivo del ciclone III fornisce nove Kbits della memoria del su chip capace di funzionamento a fino a 315 megahertz per i dispositivi del ciclone III ed a fino a 274 megahertz per i dispositivi del ciclone III LS. La struttura di memoria inclusa consiste delle colonne dei blocchetti di memoria di M9K che potete configurare come RAM, primo/in fuori amplificatori primi-fuori primi (FIFO), o ROM. I blocchetti di memoria della famiglia del dispositivo del ciclone III sono ottimizzati per le applicazioni quale il livello in tutto l'elaborazione del pacchetto, il programma incluso dell'unità di elaborazione e l'archiviazione di dati inclusa.

Il software di Quartus II permette che approfittiate dei blocchetti di memoria di M9K esemplificando la memoria facendo uso di uno stregone dedicato di megafunction o arguendo la memoria direttamente dal codice sorgente di Verilog o di VHDL.

Unico porto di sostegno dei blocchetti di memoria di M9K, doppia porta semplice e veri modi di funzionamento della doppia porta. il modo del Unico porto ed il modo semplice della doppia porta contributo a tutte le larghezze del porto con una configurazione di ×1, di ×2, di ×4, di ×8, di ×9, di ×16, di ×18, di ×32 e di ×36. La doppia porta vera è sostenuta di larghezze del porto con una configurazione di ×1, di ×2, di ×4, di ×8, di ×9, di ×16 e di ×18.

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