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Driver dell'orologio dell'orologio del ICS del temporizzatore dell'orologio di CDCVF2505PWR & orologio di distribuzione 3.3V PLL

fabbricante:
Produttore
Descrizione:
DRIVER 8TSSOP DELL'OROLOGIO DI IC PLL
Categoria:
Chip di IC di memoria flash
Prezzo:
Contact us
Metodo di pagamento:
Paypal, Western Union, TT
Specifiche
Temperatura di funzionamento minima:
- 40 C
Temperatura di funzionamento massima:
+ 85 C
Produttore:
Texas Instruments
Altezza:
1,15 mm
Lunghezza:
3 millimetri
Tipo:
Driver zero dell'orologio di ritardo PLL
Punto culminante:

timer ic chip

,

time delay ic chip

Introduzione

Driver dell'orologio dell'orologio del ICS del temporizzatore dell'orologio di CDCVF2505PWR & orologio di distribuzione 3.3V PLL

Caratteristiche 1

  • Driver dell'orologio del ciclo della Fase-serratura per il DRAM sincrono e le applicazioni per tutti gli usi
  • Orologio di spettro di diffusione compatibile

  • Frequenza operativa: 24 megahertz - 200 megahertz

  • Nervosismo basso (Ciclo--ciclo): <>

  • Distribuisce un orologio introducono all'una Banca di cinque uscite (CLKOUT usati per sintonizzare il ritardo dell'ingresso/uscita)

  • Gli Tre-stati produce quando non c'è orologio introdotto

  • Funziona a partire da singolo rifornimento 3.3-V

  • Disponibile in pacchetti di 8-Pin TSSOP e di 8-Pin SOIC

  • Consuma più di meno (tipico) di 100 mA dentro spengono il modo

  • Il ciclo di risposte interne è usato per sincronizzare le uscite all'orologio introdotto

  • serie del Su chip 25-Ω che attenua le resistenze

  • Il filtro da ciclo integrato di RC PLL elimina l'esigenza delle componenti esterne

2 applicazioni

  • DRAM sincroni

  • Applicazioni industriali

  • Amplificatori per tutti gli usi dell'orologio di Zero-ritardo

Descrizione 3

Il CDCVF2505 è un ad alto rendimento, la basso direzione obliqua, il basso nervosismo, driver dell'orologio del ciclo della fase-serratura (PLL). Questo dispositivo usa un PLL per allineare precisamente gli orologi dell'uscita (1Y [0-3] e CLKOUT) al segnale di orologio dell'input (CLKIN) sia nella frequenza che nella fase. Il CDCVF2505 funziona a 3,3 V ed inoltre fornisce integrato serie-attenuando le resistenze che lo rendono ideale per determinare i carichi punto a punto.

Una banca di cinque uscite fornisce la basso direzione obliqua, copie del basso nervosismo di CLKIN. I duty cycle dell'uscita sono regolato a 50 per cento, indipendente dal duty cycle a CLKIN. Il dispositivo entra automaticamente in spegne il modo quando nessun segnale in ingresso si applica a CLKIN.

Il filtro da ciclo per il PLLs è su chip incluso. Ciò minimizza il conteggio componente, lo spazio ed il costo.

Il CDCVF2505 è caratterizzato per l'operazione – da 40°C a 85°C.

Informazioni del dispositivo

NUMERO DEL PEZZO

PACCHETTO

DIMENSIONE CORPOREA (NOM)

CDCVF2505

SOIC (8)

4,90 millimetri di × 3,90 millimetri

TSSOP (8)

4,40 millimetri di × 3,00 millimetri

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