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MOD degli strumenti di sviluppo DAC38J84 EVAL degli strumenti di sviluppo DAC38J84 EVAL MO Data Conversion IC di IC di conversione di dati di DAC38J84EVM

fabbricante:
Produttore
Descrizione:
Campioni pungenti DAC38J84 16 2.5G al secondo il comitato di valutazione del convertitore digitale-a
Categoria:
Chip di IC di memoria flash
Prezzo:
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Metodo di pagamento:
Paypal, Western Union, TT
Specifiche
Sottocategoria:
Strumenti di sviluppo
Tipo di prodotto:
Strumenti di sviluppo di IC di conversione di dati
Tipo di interfaccia:
JESD204B
Marca:
Texas Instruments
Descrizione/funzione:
Ti del moduleme] di valutazione DAC38J84 [valore] «
Punto culminante:

semiconductor integrated circuit

,

pic microcontroller circuit

Introduzione

MOD degli strumenti di sviluppo DAC38J84 EVAL degli strumenti di sviluppo DAC38J84 EVAL MO Data Conversion IC di IC di conversione di dati di DAC38J84EVM

Descrizione funzionale
Il DAC3XJ8XEVM è inteso per la valutazione della famiglia di ad alta velocità, l'interfaccia DACs di DAC3XJ8X di JESD204B. Il segnale in ingresso digitale al DAC è fornito dal connettore di FMC (J16) su fino a otto vicoli di 12.5-Gbps SerDes facendo uso della norma di interfaccia di JESD204B. Il connettore di FMC inoltre è utilizzato per il segnale di SINCRONIZZAZIONE richiesto di stabilire il collegamento di JESD204B e sia orologio del dispositivo che segnale di SYSREF per FPGA.
L'uscita analogica del DAC3XJ8X può essere controllata sui connettori installati di SMA ha identificato IOUTA con IOUTD per i canali da A a D, rispettivamente. Le uscite analogiche sono trasformatore coppia e non passano i segnali a bassa frequenza sotto circa 10 megahertz. Il trasformatore converte l'uscita differenziale di DAC in uscita asimmetrica per uso con l'attrezzatura di laboratorio comune attraverso i collegamenti di cavo metallici di SMA.
Gli orologi per il DAC e FPGA si distribuiscono facendo uso del pulitore ultra a basso rumore del nervosismo dell'orologio LMK04828 per le applicazioni di JESD204B. Il LMK04828 può essere installato in varie configurazioni compreso il modo di distribuzione di orologio ed il modo di pulizia del nervosismo del doppio-ciclo. Nel modo di distribuzione di orologio, il tasso di uscita desiderato di DAC è fornito al connettore di CLKIN e il LMK04828 divide e distribuisce gli orologi del dispositivo ed i segnali di SYSREF. Nel modo del doppio-ciclo, il connettore di CLKIN può essere utilizzato per fornire un riferimento al LMK04828, ma gli orologi sono generati a bordo facendo uso del LMK04828 PLL e dei 122,88 megahertz a bordo VCXO.

Connettore o Jumper Label

Designatore di riferimento

Scopo

IOUTAP

J2

Uscita coppia trasformatore di DAC Channel A

IOUTBN

J8

Uscita coppia trasformatore di DAC Channel B

IOUTCP

J9

Uscita coppia trasformatore di DAC Channel C

IOUTDN

J11

Uscita coppia trasformatore di DAC Channel D

SPI_SELECTOR

JP3

Fonte scelta del segnale di SPI. Bruscamente 1-2 per il connettore di FMC, 2-3 per USB.

1.8V_SEL

JP5

Fonte scelta del rifornimento 1.8-V per CPLD. Bruscamente 1-2 per il rifornimento del bordo, 2-3 per potere di USB.

3.3V_SEL

JP6

Fonte scelta del rifornimento 3.3-V per CPLD. Bruscamente 1-2 per il rifornimento del bordo, 2-3 per potere di USB.

CLKIN

J17

L'input di orologio per LMK04828. La messa a punto di difetto fornisce l'orologio a CLKIN1 ma può essere configurata per fornire un orologio ai perni di OSCIN.

XO_PWR

JP2

Breve saltatore per fornire potere ai 122,88 megahertz a bordo VCXO per il modo di PLL del LMK04828. Se non facendo uso del VCXO, stacchi il potere di evitare l'accoppiamento nell'orologio esternamente fornito.

TXENABLE

JP1

Controlla il perno di TXENABLE del DAC3XJ8X. Breve 1-2 per permettere alla trasmissione.

SONNO

JP4

Controlla il perno di SONNO del DAC3XJ8X. Breve 1-2 per mettere DAC per dormire.

FMC_CONNECTOR

J16

Collegamento bordo a sviluppo di FPGA o di TSW14J56

USB

J14

Porto del cavo di USB

+5V_IN

J23

presa del barilotto dell'alimentazione elettrica 5-V

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