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MPU del BRACCIO Cortex-A8 del MPU Sitara del circuito integrato del microcontroller di AM3352BZCZ30 AM3352BZCZD80 AM3354BZCZA100 AM3354BZCZD80

fabbricante:
Produttore
Descrizione:
Microprocessore IC Sitara™ di ARM® Cortex®-A8 il 1 centro, 32 bit 300MHz 324-NFBGA (15x15)
Categoria:
Chip di IC di memoria flash
Prezzo:
Contact us
Metodo di pagamento:
Paypal, Western Union, TT
Specifiche
Memoria di dati del cache L1:
32 KB
Memoria di istruzione del nascondiglio L1:
32 KB
Temperatura di funzionamento massima:
+ 125 C
Temperatura di funzionamento minima:
- 40 C
Tensione di rifornimento di funzionamento:
1,1 V
Tensione dell'ingresso/uscita:
1,8 V, 3,3 V
Punto culminante:

semiconductor integrated circuit

,

pic microcontroller circuit

Introduzione

MPU del BRACCIO Cortex-A8 del MPU Sitara del circuito integrato del microcontroller di AM3352BZCZ30 AM3352BZCZD80 AM3354BZCZA100 AM3354BZCZD80

Caratteristiche 1

  • Fino al ‐ di 1-GHz SitaraTM ARM® Cortex®-A8 32 pungente unità di elaborazione di RISC

    • – Coprocessore di NEONTM SIMD

    • – 32KB di istruzione L1 e 32KB del cache di dati

      Con rilevazione di Unico errore (parità)

    • – 256KB del nascondiglio L2 con il codice correttore d'errori

      (CEE)

    • – 176KB della ROM dello stivale del Su chip

    • – 64KB di RAM dedicato

    • – Emulazione e mettere a punto - JTAG

    • – Regolatore di interruzione (interruzione fino a 128

      Richieste)

  • Memoria del Su chip (L3 comune RAM)

    • – 64KB del regolatore per tutti gli usi di memoria del Su chip (OCMC) RAM

    • – Accessibile a tutti i padroni

    • – Sostiene la conservazione per sveglia veloce

  • Interfacce esterne di memoria (EMIF)

    • – mDDR (LPDDR), DDR2, DDR3, regolatore di DDR3L:

      • – mDDR: 200-MHz orologio (tasso di dati 400-MHz)

      • – DDR2: 266-MHz orologio (tasso di dati 532-MHz)

      • – DDR3: 400-MHz orologio (tasso di dati 800-MHz)

      • – DDR3L: 400-MHz orologio (dati 800-MHz

        Tasso)

      • – canale omnibus di dati di 16 bit

      • – 1GB di spazio indirizzabile totale

      • – Sostiene il dispositivo di memoria un x16 o due x8

        Configurazioni

    • – Regolatore per tutti gli usi di memoria (GPMC)

      • – 8 bit flessibile ed interfaccia asincrona di memoria di 16 bit con fino a sette Chip Selects (NAND, NÉ, Muxed-NÉ, SRAM)

      • – Usa il codice di BCH per sostenere 4, 8, o le CEE di 16 bit

      • – Usa il codice di Hamming per sostenere le CEE di 1 bit

    • – Modulo dell'indicatore di posizione di errori (OLMO)

      • – Usato insieme con il GPMC per individuare gli indirizzi degli errori di dati dai polinomi di sindrome generati facendo uso di un algoritmo di BCH

      • – Supporti 4, 8 e 16 bit per posizione di errore del blocco 512-Byte basata sugli algoritmi di BCH

2 applicazioni

  • Unità periferiche di gioco

  • Automazione domestica ed industriale

  • Apparecchi medici del consumatore

  • Stampanti

  • Sistemi astuti del tributo

    • Distributori automatici collegati

  • Bilance

  • Consoli educative
    • Giocattoli avanzati

1,3 descrizione

I microprocessori di AM335x, in base all'unità di elaborazione del BRACCIO Cortex-A8, sono migliorati con l'immagine, i grafici che elaborano, le unità periferiche e le opzioni di interfaccia industriali quali EtherCAT e PROFIBUS. I dispositivi sostengono i sistemi operativi ad alto livello (HLOS). L'unità di elaborazione SDK Linux® e TI-RTOS è disponibile gratis da TI.

Il microprocessore di AM335x contiene i sottosistemi indicati nello schema a blocchi funzionale e una descrizione sommaria di ciascuna segue:

Contiene i sottosistemi indicati nello schema a blocchi funzionale e una descrizione sommaria di ciascuna segue:

Il sottosistema dell'unità di microprocessore (MPU) è basato sull'unità di elaborazione del BRACCIO Cortex-A8 ed il sottosistema dell'acceleratore grafico di PowerVR SGXTM fornisce l'accelerazione dei grafici 3D per supporto di visualizzazione gli effetti di gioco e.

Il PRU-ICSS è a parte dal centro del BRACCIO, permettendo l'operazione indipendente e cronometrando per la maggiori efficienza e flessibilità. Il PRU-ICSS permette alle interfacce periferiche supplementari ed ai protocolli in tempo reale come EtherCAT, PROFINET, EtherNet/IP, PROFIBUS, Ethernet Powerlink, Sercos ed altri. Ulteriormente, la natura programmabile del PRU-ICSS, con il suo accesso ai perni, eventi e tutte le risorse del sistema-su-chip (SoC), fornisce la flessibilità nell'implementare le risposte veloci e in tempo reale, le operazioni della manipolazione dei dati specializzate, interfacce periferiche su ordinazione e nelle mansioni scaricanti dagli altri centri dell'unità di elaborazione della Soc.

Informazioni del dispositivo

NUMERO DEL PEZZO

PACCHETTO

DIMENSIONE CORPOREA

AM3359ZCZ

NFBGA (324)

15,0 millimetri di × 15,0 millimetri

AM3358ZCZ

NFBGA (324)

15,0 millimetri di × 15,0 millimetri

AM3357ZCZ

NFBGA (324)

15,0 millimetri di × 15,0 millimetri

AM3356ZCZ, AM3356ZCE

NFBGA (324), NFBGA (298)

15,0 millimetri di × 15,0 millimetri, 13,0 millimetri di × 13,0 millimetri

AM3354ZCZ, AM3354ZCE

NFBGA (324), NFBGA (298)

15,0 millimetri di × 15,0 millimetri, 13,0 millimetri di × 13,0 millimetri

AM3352ZCZ, AM3352ZCE

NFBGA (324), NFBGA (298)

15,0 millimetri di × 15,0 millimetri, 13,0 millimetri di × 13,0 millimetri

AM3351ZCE

NFBGA (298)

13,0 millimetri di × 13,0 millimetri

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